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PIC18F85J11 FAMILY
DS39774D-page 114
2010 Microchip Technology Inc.
FIGURE 10-1:
PIC18F85J11 FAMILY INTERRUPT LOGIC
TMR0IE
GIE/GIEH
PEIE/GIEL
Wake-up if in
Interrupt to CPU
Vector to Location
0008h
INT2IF
INT2IE
INT2IP
INT1IF
INT1IE
INT1IP
TMR0IF
TMR0IE
TMR0IP
RBIF
RBIE
RBIP
IPEN
TMR0IF
TMR0IP
INT1IF
INT1IE
INT1IP
INT2IF
INT2IE
INT2IP
RBIF
RBIE
RBIP
INT0IF
INT0IE
PEIE/GIEL
Interrupt to CPU
Vector to Location
IPEN
0018h
PIR1<6:3,1:0>
PIE1<6:3,1:0>
IPR1<6:3,1:0>
High-Priority Interrupt Generation
Low-Priority Interrupt Generation
Idle or Sleep modes
GIE/GIEH
INT3IF
INT3IE
INT3IP
INT3IF
INT3IE
INT3IP
PIR2<7:6,3:1>
PIE2<7:6 3:1>
IPR2<7:6,3:1>
PIR3<6:4,2:1>
PIE3<6:4,2:1>
IPR3<6:4,2:1>
PIR1<6:3,1:0>
PIE1<6:3,1:0>
IPR1<6:3,1:0>
PIR2<7:6,3:1>
PIE2<7:6,3:1>
IPR2<7:6,3:1>
PIR3<6:4,2:1>
PIE3<6:4,2:1>
IPR3<6:4,2:1>
IPEN
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